MAX14850
Six-Channel Digital Isolator
Test Circuits/Timing Diagrams
V CCA
INA1, INA2
50%
50%
V CCA
0.1μF
V CCA
V CCB
0.1μF
V CCB
GNDA
V CCB
t DPLH
t DPHL
50 ?
INA_
MAX14850
OUTB_
OUTB1
GNDB
50%
50%
TEST
SOURCE
GNDA
GNDB
C L
R L
V CCB
90%
t DSKEWCC
OUTB2
50%
(A)
GNDB
10%
t R
t F
(B)
Figure 1. Test Circuit (A) and Timing Diagram (B) for Unidirectional Channels
V CCA
R 1
0.1μF
V CCA
V CCB
0.1μF
R 2
V CCB
I/OA_
MAX14850
I/OB_
C L1
GNDA
GNDB
C L2
TEST
SOURCE
(A)
V CCA
V CCB
I/OA1, I/OA2
GNDA
V CCB
50%
t DPLH
50%
t DPHL
I/OB1, I/OB2
GNDB
V CCA
50%
t DPLH
50%
t DPHL
I/OB1
50%
50%
I/OA1
50%
50%
I/OB2
V OL (min)
V CCB
t DSKEWCC
50%
90%
I/OA2
V OL (min)
V CCA
t DSKEWCC
50%
90%
V OL (min)
t F
10%
V OL (min)
t F
10%
(B)
Figure 2. Test Circuit (A) and Timing Diagrams (B) and (C) for Bidirectional Channels
Maxim Integrated
(C)
7
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